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W631GG6KB
T0
Ta
Tb0
Tc0
Tc1
Tc2
Tc3
Tc4
Tc5
Tc6
Tc7
Tc8
Tc9
T10
Td
CK#
CK
Command
PREA
MRS
READ *1
READ *1
NOP
NOP
NOP
NOP
NOP
NOP
NOP
NOP
NOP
MRS
VALID
BA
A[1:0]
A[2]
A[9:3]
t RP
3
0
1
00
t MOD
VALID
0 *2
0 *2
VALID
t CCD
VALID
0 *2
0 *2
VALID
t MPRR
3
VALID
0
00
t MOD
A10/AP
A[11]
A12/BC#
1
0
0
0
VALID
VALID
VALID *1
VALID
VALID
VALID *1
0
0
0
RL
DQS, DQS#
RL
DQ
NOTES:
1. RD with BL8 either by MRS or on the fly.
TIME BREAK
DON'T CARE
2. Memory Controller must drive 0 on A[2:0].
Figure 18 – MPR Readout of pre-defined pattern, BL8 fixed burst order, back-to-back readout
Publication Release Date: Dec. 09, 2013
Revision A05
- 39 -
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